Lỗi này có thể xảy ra khi biên dịch một dự án chứa bộ điều khiển LPDDR2 và một hoặc nhiều khối kết thúc trên chip không liên quan (OCT).
Lý do là đầu ra chỉ ghim: CA[9:0], CKE, CK, CK_n và CS_n không liên quan đến khối kiểm soát chấm dứt trong mã RTL và họ yêu cầu một bài tập để liên kết chúng với khối kiểm soát chấm dứt trong bộ điều khiển LPDDR2.
Thêm bài tập Khối điều khiển Chấm dứt vào các chân đầu ra sau từ bộ điều khiển LPDDR2:
CA, CKE, CK, CK_n và Các CS_n
Giá trị của bài tập nên được thực hiện cho khối điều khiển OCT trong bộ điều khiển LPDDR2 với đường dẫn phân cấp sau: < tên biến đổi>|altera_mem_if_oct_cyclonev:oct0|sd1a_0
Vấn đề này dự kiến sẽ được khắc phục trong bản phát hành phần mềm Quartus® II trong tương lai.